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法律学8086 微处理器引脚图
英特尔 8086 是一款 40 引脚 DIP 微处理器。在这里，我们将看到 8086 MPU 的实际引脚级图。
8086 是第一个 16 位微处理器，它采用 40 引脚 DIP（双列直插式封装）芯片。现在让我们详细讨论一下 8086 微处理器的引脚配置。
这是 8086 微处理器的实际引脚图。
现在让我们看看 8086 微处理器的引脚功能。
| 引脚 | 功能 |
|---|---|
| AD15 – AD0 | 这是 16 位地址/数据总线。AD0-AD7 传输低位字节数据，AD8-AD15 传输高位字节数据。在第一个时钟周期，它传输 16 位地址，之后它传输 16 位数据。 |
| A16 – A19 | 这是 4 位地址/状态总线。在第一个时钟周期，它传输 4 位地址，之后它传输状态信号。 |
| Vcc | 它在 VCC 引脚 40 使用 5V 直流电源。 |
| GND | 这是 VSS 引脚 1 和 20 的接地。 |
| 时钟 | 时钟信号通过引脚 19 提供。它为处理器提供操作时序。其频率在不同版本中有所不同，即 5MHz、8MHz 和 10MHz。 |
| S7/BHE | BHE 代表总线高位使能。它位于引脚 34，用于指示使用数据总线 D8-D15 传输数据。此信号在第一个时钟周期为低电平，之后处于活动状态。 |
| 读(RD) | 它位于引脚 32，用于读取读操作信号。 |
| 准备好 | 它位于引脚 32。它是 I/O 设备发出的确认信号，表示数据已传输。它是一个高电平有效信号。当它为高电平时，表示设备已准备好传输数据。当它为低电平时，表示等待状态。 |
| 复位 | 它位于引脚 21，用于重新启动执行。它会导致处理器立即终止其当前活动。此信号在前 4 个时钟周期内为高电平以复位微处理器。 |
| 中断 | 它位于引脚 18。它是一个中断请求信号，在每条指令的最后一个时钟周期进行采样，以确定处理器是否将其视为中断。 |
| NMI | 它代表非屏蔽中断，位于引脚 17。它是一个边沿触发的输入，它向微处理器发出中断请求。 |
| 测试 | 此信号类似于等待状态，位于引脚 23。当此信号为高电平时，处理器必须等待空闲状态，否则执行将继续。 |
| MN/MX | 它代表最小/最大，位于引脚 33。它指示处理器要运行的模式；当它为高电平时，它以最小模式工作，反之亦然。 |
| INTA | 它是一个中断确认信号，位于引脚 24。当微处理器接收到此信号时，它会确认中断。 |
| ALE | 它代表地址使能锁存器，位于引脚 25。每次处理器开始任何操作时都会生成一个正脉冲。此信号指示地址/数据线上是否有有效地址。 |
| DEN | 它代表数据使能，位于引脚 26。它用于使能收发器 8286。收发器是一种用于将数据与地址/数据总线分开的设备。 |
| DT/R | 它代表数据传输/接收信号，位于引脚 27。它决定通过收发器的数据流方向。当它为高电平时，数据被发送出去，反之亦然。 |
| M/IO | 此信号用于区分内存和 I/O 操作。当它为高电平时，表示 I/O 操作；当它为低电平时，表示内存操作。它位于引脚 28。 |
| WR | 它代表写信号，位于引脚 29。它用于将数据写入内存或输出设备，具体取决于 M/IO 信号的状态。 |
| HLDA | 它代表保持确认信号，位于引脚 30。此信号确认保持信号。 |
| 保持 | 此信号指示处理器外部设备正在请求访问地址/数据总线。它位于引脚 31。 |
| QS1 和 QS0 | 这些是队列状态信号，位于引脚 24 和 25。这些信号提供指令队列的状态。 |
| S0、S1、S2 | 这些是状态信号，提供操作的状态，总线控制器 8288 使用这些状态信号生成内存和 I/O 控制信号。它们位于引脚 26、27 和 28。 |
| 锁定 | 当此信号处于活动状态时，它指示其他处理器不要请求 CPU 离开系统总线。它使用任何指令上的 LOCK 前缀激活，位于引脚 29。 |
| RQ/GT1 和 RQ/GT0 | 这些是请求/授予信号，其他处理器使用这些信号请求 CPU 释放系统总线。当 CPU 接收到该信号时，它会发送确认。RQ/GT0 的优先级高于 RQ/GT1。 |
QS0 和 QS1 有一些条件。这些条件如下所示。
| QS0 | QS1 | 状态 |
|---|---|---|
| 0 | 0 | 无操作 |
| 0 | 1 | 队列中的操作码的第一个字节 |
| 1 | 0 | 清空队列 |
| 1 | 1 | 队列中的后续字节 |
S2、S1 和 S0 是状态信号。以下是状态及其位模式列表。
| S2 | S1 | S0 | 状态 |
|---|---|---|---|
| 0 | 0 | 0 | 中断确认 |
| 0 | 0 | 1 | I/O 读取 |
| 0 | 1 | 0 | I/O 写入 |
| 0 | 1 | 1 | 停止 |
| 1 | 0 | 0 | 操作码获取 |
| 1 | 0 | 1 | 内存读取 |
| 1 | 1 | 0 | 内存写入 |
| 1 | 1 | 1 | 被动 |
更新于：2019-07-30
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